MIPS-master_MIPS_vivado_mipscpu单周期_MIPS单周期cpu_vhdl

6.0
Vivado使用教程 vivado2018.2.pdf

6.0
基于FPGA的FSK调制解调通信系统,verilog编程开发,vivado2019.2平台运行+含代码操作演示视频

32.0
Verilog实现基于cordic算法计算蝶形运行结构实现FFT,vivado平台开发,包含测试testbench-源码

6.0
vivado2019.2版本中纯verilog开发的数字时钟设计，具有记时+秒表的功能

12.0
在vivado2019.2平台中verilog开发的DDS直接数字频率合成器,频率和相位控制字可配置+代码操作视频

32.0
spi.rar_FPGA SPI_SPI FPGA_SPI程序_fpga spi _spi vivado

6.0
SPI.zip_spi_spi vivado_spi接口代码_vivado spi接口_vivado中spi程序

6.0
基于Verilog的数字锁相环设计,在vivado2019.2中开发带testbench+代码操作视频

32.0
基于FPGA的1024点FFT变换,verilog编程实现,vivado2019.2平台开发,含testbench+含代

32.0
【提供操作视频】vivado2019.2平台使用verilog开发的OFDM调制解调系统,包括编译码,FFT,IFFT,

32.0
FPGA实现Jpeg压缩，和视频采集程序,jpeg图像压缩算法的实现,Vivado

6.0
FPGA实现Jpeg压缩，和视频采集程序,jpeg图像压缩算法的实现,Vivado源码.rar

6.0
基于XDMA的PCIE VIVADO工程

8.0
dvi2rgb_dvi2rgb_dvirgb_DVI_vivado_

6.0
计算机组成与结构实验基于vivado实现的单周期流水线CPU源码及仿真+实验报告

6.0
FPGA交通灯定时系统 EGO1开发板 Vivado工程 Verilog代码.rar

9.9
Vivado2019.1安装包-百度网盘-22G.zip

6.0
【提供操作视频】vivado2019.2平台中纯verilog开发的NMS归一化最小和LDPC译码实现,含testben

58.0
利用Carry4实现TDC

22.0
VIVADO FFT IP核使用以及MATLAB验证（有详细的源代码和注释）

8.0
Tetris_fpga_fpga经典游戏_俄罗斯方块_vivado_

6.0
vivado常用综合属性.zip_vivado_vivado 约束_vivado约束_常用属性_常用综合属性

6.0

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